Анализ алгоритма работы специализированного вычислителя

– отключить прибор от USB-шины, разомкнув перемычку Р2 (линия VREF);

– удерживая кнопки К3 (линия RESET) и К2 (линия PSEN) подключить прибор к USB-шине, замкнув перемычку Р2;

– отпустить кнопку К3;

– отпустить кнопку К2.

На базе схемы приведенной на рисунке 3.3 получаем схему включения контроллера представленную на рисунке 3.4. В данной схеме шина адреса, шина данных и управляющ

ие сигналы, необходимые для работы микроконтроллера с внешними устройствами соединены с ПЛИС, а перевод контроллера в режим загрузки осуществляется при помощи переключателя S21.

Рисунок 3.3 – Типовая схема включения контроллера

Рисунок 3.4 – Схема соединения для микроконтроллера AT89C5131

3.3 Микросхема часов реального времени и их питание

Схема включения микросхемы часов реального времени приведена на рисунке 3.5. Особенностью данной схемы является параллельное включение четырех конденсаторов большой емкости (1 Ф) в цепь питания микросхемы. Эти конденсаторы выполняют роль аккумулятора.

Рисунок 3.5 – Эквивалентная схема питания часов реального времени в автономном режиме работы

Аккумулятор предназначен для обеспечения питания микросхемы часов реального времени при отсутствии общего питания. Это необходимо при проведении автономных летных испытаний для того чтобы обеспечить бесперебойную работу часов до момента окончательной проверки изделия и начала испытания (включения прибора). Временная диаграмма заряда/разряда конденсаторной батареи приведена на рисунке 3.6.

Рисунок 3.6 – Временная диаграмма заряда/разряда конденсаторной батареи

При этом время заряда Тзаряда можно оценить как

Тзаряда = 3 · t, (3.1)

где t = R · C, (3.2)

а время разряда Тразряда как

, (3.3)

где ΔU = (4,5–2,5) B;

I = 10 мА – ток разряда, с учетом утечек через диод и выводы микросхем;

С = 4 Ф – емкость аккумуляторов.

3.4 Компоновка банков накопителя

Накопитель организован на 16 микросхемах ФЛЭШ-памяти K9K49G08U0M, которые разделим на четыре банка, по четыре микросхемы в каждом банке (рисунок 3.7). Это сделано для того чтобы иметь возможность устранить времена простоя (занятости) накопителя при циклах записи. Все 16 микросхем имеют общую шину данных, сигналы записи, чтения, записи команд и адреса. Выборка между микросхемами осуществляется сигналом Выбора микросхемы (СЕ). Сигналы R/B (свободен/занят) микросхем, объединенных в банк, соединены, следовательно для анализа контроллеру доступно четыре сигнала свободен/занят (R/B) определяющие занятость банков.

Рисунок 3.7 – Структура накопителя

Такое построение накопителя с одной стороны позволяет производить непрерывную запись в него, а с другой стороны оптимизирует число линий связи необходимое для его обслуживания.

3.5 Быстрая промежуточная память

Скоростная буферная память организована на микросхеме быстродействующего ОЗУ IDT71V424S15YI. Она имеет организацию 512к×8, и позволяет производить запись с периодом 15 нс. Микросхема всеми сигнальными выводами подключена к ПЛИС, так как имеет связи только с ее внутренними узлами.

3.6 Исходные данные на проектирование разрабатываемой системы

При разработке конструкции необходимо применить многослойный стеклотекстолит. Габаритные размеры, места креплений, расположение разъёмов ESQT аналогично ячейке АЦП-079-03. Контакты всех разъёмов не должны измениться. Фильтрующие конденсаторы располагать вблизи выводов микросхем потребителей. В схеме применена программируемая логическая матрица фирмы ALTERA.

Выводы элемента IDT71V424S пригодные для перестановки приведены в таблице 3.3. Выводы разделены на две независимые группы. Данная перестановка применима только для этого проекта.

Таблица 3.3 – Выводы элемента IDT71V424S

 Скачать реферат